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ASIC/FPGA Design and Verification Engineer

offline
  • auf Anfrage
  • OX2 6EY Oxford
  • Europa
  • en
  • 09.01.2020

Kurzvorstellung

ASIC/FPGA Design and Verification Engineer.

Qualifikationen

  • Analogtechnik / Analogelektronik
  • Digitaltechnik / Digitalelektronik
  • Elektrische Energietechnik
  • Verilog HDL
  • VHDL (VHSIC Hardware Description Language)

Projekt‐ & Berufserfahrung

Senior FPGA/ASIC Design Engineer
Kundenname anonymisiert, Antwerp
10/2017 – 9/2019 (2 Jahre)
Telekommunikation
Tätigkeitszeitraum

10/2017 – 9/2019

Tätigkeitsbeschreibung

• Beamforming of antenna module for 28GHz 5G products.
• Completed RTL according to design rules.
• Interwork & Design Documentation
• 5G NR Beamforming FPGA:
o Beamforming of antenna module for 39GHz 5G products.
o Completed: RTL according to design rules.
o Static Timing Analysis (STA) of FPGA IO interfaces, Synthesis constraints.
• Testbench development with Verilog and System Verilog. Also verification of microprocessor systems using C and assembler.
• Mixed signal integration, modeling and simulation.
• Validation of ASICs. Software development and debug using in-circuit emulators.

Eingesetzte Qualifikationen

Field Programmable Gate Array (FPGA), VHDL (VHSIC Hardware Description Language)

Über mich

Design/Verification Engineer.

Persönliche Daten

Sprache
  • Englisch (Muttersprache)
Reisebereitschaft
Europa
Arbeitserlaubnis
  • Europäische Union
Profilaufrufe
839
Alter
44
Berufserfahrung
21 Jahre und 10 Monate (seit 06/2002)

Kontaktdaten

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